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ADSP-21462/ADSP-21465/ADSP-21467/ADSP-21469
SPECIFICATIONS
OPERATING CONDITIONS
Preliminary Technical Data
450 MHz
400 MHz
Unit
Parameter 1
Description
Min
Max
Min
Max
Unit
TBD
V DD_INT
Internal (Core) Supply Voltage
2
TBD
2
TBD
3
TBD
3
V
V DD_DDR2
V DD_EXT
V REF
V IH 5
4
External (I/O) Supply Voltage
DDR2 Controller Supply Voltage
DDR2 Reference Voltage
High Level Input Voltage @ V DD_EXT = max
3.13
1.7
0.84
2.0
3.47
1.9
0.96
V DD_EXT + 0.5
3.13
1.7
0.84
2.0
3.47
1.9
0.96
V DD_EXT + 0.5
V
V
V
V
V IL
4
Low Level Input Voltage @ V DD_EXT = min
–0.3
0.8
–0.3
0.8
V
V IH_CLKIN
6
High Level Input Voltage @ V DD_EXT = max
TBD
TBD
TBD
TBD
V
V IL_CLKIN 5
V IL_DDR2 (DC)
V IH_DDR2 (DC)
Low Level Input Voltage @ V DD_EXT = min
DC Low Level Input Voltage
DC High Level Input Voltage
TBD
-0.3
V REF + 0.13
TBD
V REF – 0.12
V DD_DDR2 + 0.3
TBD
-0.3
V REF + 0.13
TBD
V REF – 0.12
V DD_DDR2 + 0.3
V
V
V
V IL_DDR2 (AC)
V IH_DDR2 (AC)
AC Low Level Input Voltage
AC High Level Input Voltage
V REF + 250
V REF – 250
V REF + 250
V REF – 250
mV
mV
T J
Junction Temperature 208-Lead PBGA @
T AMBIENT 0 ° C to +70 ° C
0
125
0
125
° C
1
2
3
4
5
6
Specifications subject to change without notice.
The expected value is 1.1V and initial customer designs should design with a programmable regulator that can be adjusted from 0.95V to 1.15V +/-50mV
The expected value is 1.05V and initial customer designs should design with a programmable regulator that can be adjusted from 0.95V to 1.15V +/-50mV
Applies to DDR2 signals.
Applies to input and bidirectional pins: AMI_ADDR23–0, AMI_DATA7–0, FLAG3–0, DAI_Px, DPI_Px, SPIDS, BOOTCFGx, CLKCFGx, CLKOUT (RUNRSTIN), RESET,
TCK, TMS, TDI, TRST.
Applies to input pin CLKIN.
Rev. PrC
| Page 18 of 62 | January 2009
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